プログラマ IC 内部回路 SST25VF064C-80-4I-Q2AE-T 64 Mbit SPI シリアル
ic programmer circuit
,programmable audio chip
プログラマ IC 内部回路 SST25VF064C-80-4I-Q2AE-T 64 Mbit SPI シリアル
SST25VF064C-80-4I-Q2AE-T64 Mビット SPI シリアル デュアル I/O フラッシュ
特徴：
• 単一電圧の読み取りおよび書き込み動作 – 2.7 ～ 3.6V
• シリアルインターフェースアーキテクチャ
– SPI 互換: モード 0 およびモード 3
• デュアル入力/出力のサポート
– 高速読み取りデュアル出力命令
– 高速読み取りデュアル I/O 命令
• 高速クロック周波数
– 高速読み取り用 80 MHz (0BH)
– 高速読み取りデュアル出力 (3BH) の場合は 75 MHz
– 高速読み取りデュアル I/O (BBH) の場合は 50 MHz
– 読み取り命令用の 33 MHz (03H)
・優れた信頼性
– 耐久性: 100,000 サイクル (標準)
– 100 年を超えるデータ保持
• 低消費電力
– アクティブ読み取り電流: 12 mA (標準 @ 80 MHz) (シングルビット読み取りの場合)
– アクティブ読み取り電流: デュアルビット領域で 14 mA (通常 @ 75MHz)
d)
– スタンバイ電流: 5 µA (標準値)
• 柔軟な消去機能
– 均一な 4 K バイトのセクター
– 均一な 32 K バイトのオーバーレイ ブロック
– 均一な 64 K バイトのオーバーレイ ブロック
• 高速消去 – チップ消去時間: 35 ms (標準値)
– セクタ/ブロック消去時間: 18 ms (標準値)
• ページプログラム – ページあたり 256 バイト
– シングルおよびデュアル入力のサポート
– 1.5 ミリ秒（標準）の高速ページ プログラム時間
• 書き込み終了の検出
– ソフトウェアによるステータス レジスタの BUSY ビットのポーリング
• 書き込み保護 (WP#)
– ステータスレジスタのロックダウン機能を有効/無効にします。
• ソフトウェア書き込み保護
– ステータスレジスタのブロック保護ビットによる書き込み保護
• セキュリティID
– ワンタイム プログラマブル (OTP) 256 ビット、セキュア ID
- 64 ビットの一意の、工場で事前にプログラムされた識別子
- 192 ビット ユーザーがプログラム可能
• 温度範囲
– 商用 = 0°C ～ +70°C
– 工業用: -40°C ～ +85°C
• 利用可能なパッケージ
– 16 ピン SOIC (300 ミル)
– 8 接点 WSON (6mm x 8mm)
– 8 ピン SOIC (200 ミル)
• すべてのデバイスは RoHS に準拠しています
| 製品説明 | 記憶の整理 | デバイスの操作 |
| SST 25 シリーズ シリアル フラッシュ ファミリは、4 線式の SPI 互換インターフェイスを備えており、ピン数の少ないパッケージを使用できるため、基板占有スペースが少なくなり、最終的にシステムの総コストが削減されます。SST25VF064C SPI シリアル フラッシュ メモリは、SST 独自の高性能 CMOS スーパーフラッシュ テクノロジを使用して製造されています。スプリットゲートセル設計と厚膜酸化膜トンネルインジェクターにより、代替アプローチと比較してより優れた信頼性と製造性が実現します。 | SST25VF064C スーパーフラッシュ メモリ アレイは、32 K バイトのオーバーレイ ブロックと 64 KB のオーバーレイ消去可能ブロックを備えた均一な 4 K バイトの消去可能セクターで構成されています。 | SST25VF064C は、SPI (シリアル ペリフェラル インターフェイス) バス互換プロトコルを通じてアクセスされます。SPI バスは 4 つの制御線で構成されます。チップ イネーブル (CE#) はデバイスの選択に使用され、データはシリアル データ入力 (SI)、シリアル データ出力 (SO)、およびシリアル クロック (SCK) を通じてアクセスされます。 |
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| イメージ | 部分# | 記述 | |
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