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AD9862BSTZRLのデータ変換装置ICのアナログの前部分- AFEの複雑な兆候のフロントエンド プロセッサ

メーカー:
製造者
記述:
RFの前部分LMDS、MMDS 128-LQFP (14x20)
部門:
フラッシュ・メモリICの破片
価格:
Contact us
支払方法:
Paypal、ウェスタンユニオン、TT
指定
単位重量:
0.021693 oz
下位範疇:
データ変換装置IC
製品タイプ:
アナログの前部分- AFE
作動の供給電圧:
3.3 V
作動の供給の流れ:
104 mA
ブランド:
アナログ・デバイセズ
ハイライト:

dac integrated circuit

,

da converter chip

導入

AD9862BSTZRLのデータ変換装置ICのアナログの前部分- AFEの複雑な兆候のフロントエンド プロセッサ

特徴

  • 二重コンバーターが付いている混合され信号のフロントエンド プロセッサ
  • 送信するシグナル パスを受け取るシグナル パスを下記のものを含んでいるコンバーター受け取り、二倍にしなさい:
  • 2 10 /12ビット、内部か外的な独立した参照のA/Dのコンバーターを、入力バッファ見本抽出する、64 MSPSプログラム可能な利益アンプ、低域殺害フィルターおよびデジタルHilbertフィルター
  • シグナル パスを下記のものを含んでいる送信しなさい:
  • 2 12 /14ビット、プログラム可能なフル・スケールの出力電流が付いている128のMSPS D/Aのコンバーター、チャネルの独立した良い利益およびオフセット制御、デジタルHilbertおよび補入フィルター、およびデジタル調整可能な実質または複雑なコンバーター
  • Delay-Lockedループ時計の乗数および統合されたタイミング世代別回路部品は単結晶かクロック オペレーションを可能にする
  • 二重多重型にされた入力が付いているプログラム可能な出力時計、連続プログラム可能なインターフェイス、プログラム可能なシグマ デルタ、3補助DACの出力および2つの補助ADCs

適用

  • 広帯域ワイヤレス システム
  • 固定無線電信、WLAN、MMDSのLMDSの広帯域ワイヤーライン システム
  • ケーブル モデム、VDSLのPowerPlugデジタル通信
  • セット トップ ボックス、データ モデム

概説

AD9860およびAD9862 (AD9860/AD9862)は広帯域通信の市場のために最大限に活用される多目的な統合された混合され信号の前部終り(MxFE)である。AD9860/AD9862は基づいて無線またはワイヤーラインの標準または動的パフォーマンス、電力損失、費用およびサイズがすべて重大な属性の専有ブロードバンド モデム システムのための費用効果が大きい、複雑な兆候の解決である。AD9860に10ビットADCsおよび12ビットDACsがある;AD9862に12ビットADCsおよび14ビットDACsがある。AD9860/AD9862はそれぞれがHilbert高性能、10 /12ビット、64 MSPSのアナログ・ディジタル変換器(ADC)、入力バッファ、プログラム可能な利益アンプ(RxPGA)、デジタル フィルターおよび殺害フィルターを含んでいる2つのチャネルから道(Rx)を成っている受け取る。Rxがベースバンドで実質、多様性、またはI/Qデータまたは低い受け取るのに使用することができる。入力バッファはチャネルが両方とも外的な部品(例えば、鋸フィルター)とのインピーダンス・マッチングを楽にすることができるように一定した入力インピーダンスを提供する。RxPGAは両方のチャネルに20 dBの利益範囲を提供する。アウトプット データ バスはいろいろなインターフェイスの種類を収容するために多重型にすることができる。AD9860/AD9862は高性能、12 /14ビット、128のMSPSのデジタル アナログ変換器(DAC)、プログラム可能な利益アンプ(TxPGA)、複雑なか実質信号の周波数変調のための補入フィルター、Hilbertフィルターおよびデジタル ミキサーを含んでいる2つのチャネルから道(Tx)を成っている送信する。Tx掛け金およびデマルチプレクサー回路部品は実質またはI/Qデータを処理できる。2の補入率か。そして4か。外的な復元フィルターの条件を楽にすること利用できてであって下さい。単一チャネルシステムのためにイメージの拒絶の建築を作成するのに、外的な求積法の変調器とHilbertデジタル フィルターが使用することができる。2 12 /14ビット、高性能のDACsの農産物TxPGAによって20 dBの範囲に量ることができる出力信号。プログラム可能なdelay-lockedループ(DLL)時計の乗数および統合されたタイミング回路はまた単一の外部参照の時計または外的な水晶の使用を可能にするためにすべての内部ブロックのために時間を記録することを発生させるおよび2外的なクロック出力を提供する。付加的な特徴はプログラム可能なシグマ デルタの出力、4つの補助ADCの入力および3補助DACの出力を含んでいる。装置プログラム可能性はシリアル ポート インターフェイス(SPI)によってレジスタ・バンクと結合した促進される。AD9860/AD9862はスペース節約の128鉛LQFPで利用できる。

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